FPGA modeling for SoC design exploration

Dominique Blouin 1 Eric Senn 2 Robin Bonamy 3 Daniel Chillet 3 Sebastien Bilavarn 4 Christian Samoyeau 5
1 Lab-STICC - Laboratoire des sciences et techniques de l'information, de la communication et de la connaissance (UMR 3192)
2 Lab-STICC_UBS_CACS_MOCS
Lab-STICC - Laboratoire des sciences et techniques de l'information, de la communication et de la connaissance
3 CAIRN - Energy Efficient Computing ArchItectures with Embedded Reconfigurable Resources
Inria Rennes – Bretagne Atlantique , IRISA-D3 - ARCHITECTURE
4 LEAT - Laboratoire d'Electronique, Antennes et Télécommunications
5 InPixal [Rennes]
Type de document :
Communication dans un congrès
HEART (International Workshop on Highly-Efficient Accelerators and Reconfigurable Technologies, Jun 2011, London, United Kingdom. 2011
Liste complète des métadonnées
https://hal.inria.fr/hal-00650630
Contributeur : Daniel Chillet <>
Soumis le : dimanche 11 décembre 2011 - 21:14:29
Dernière modification le : vendredi 7 décembre 2018 - 01:52:10

Identifiants

  • HAL Id : hal-00650630, version 1

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Citation

Dominique Blouin, Eric Senn, Robin Bonamy, Daniel Chillet, Sebastien Bilavarn, et al.. FPGA modeling for SoC design exploration. HEART (International Workshop on Highly-Efficient Accelerators and Reconfigurable Technologies, Jun 2011, London, United Kingdom. 2011. 〈hal-00650630〉

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