Crypto-processeur ECC en RNS sur FPGA avec inversion modulaire rapide - Archive ouverte HAL Access content directly
Conference Papers Year : 2013

Crypto-processeur ECC en RNS sur FPGA avec inversion modulaire rapide

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Abstract

Nous développons un crypto-processeur RNS pour ECC sur Fp à la fois très rapide et robuste face à certaines SCA. Dans ce article court, nous décrivons l'utilisation de RNS pour ECC, l'architecture générale de notre crypto-processeur et son implantation sur FPGA. Nous présentons un nouvel algorithme d'inversion modulaire RNS basé sur l'algorithme d'Euclide binaire étendu qui permet une accélération d'un facteur 6.
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Dates and versions

hal-00830610 , version 1 (05-06-2013)

Identifiers

  • HAL Id : hal-00830610 , version 1

Cite

Karim Bigou, Arnaud Tisserand. Crypto-processeur ECC en RNS sur FPGA avec inversion modulaire rapide. Colloque national du GDR SoC-SiP - 2013, Jun 2013, Lyon, France. ⟨hal-00830610⟩
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