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Conference papers

Parcours par liste de chemins : une nouvelle classe de mécanismes de suivi de flot SIMT

Caroline Collange 1 Nicolas Brunie 2
1 PACAP - Pushing Architecture and Compilation for Application Performance
Inria Rennes – Bretagne Atlantique , IRISA-D3 - ARCHITECTURE
Résumé : Le modèle d’exécution SIMT employé dans les GPU synchronise l’exécution de groupes de threads afin d’exécuter leurs instructions communes sur des unités SIMD. Ce modèle nécessite des mécanismes matériels ou logiciels pour gérer la divergence et la reconvergence de contrôle entre threads. Une nouvelle classe de tels algorithmes émerge dans la littérature depuis quelques années. Nous présentons une classification de ces techniques sur la base de leur caractéristique commune, un parcours de graphe à base de liste. Nous comparons le coût de mise en œuvre sur FPGA de deux variantes du processeur Simty, l’une basée sur un tel mécanisme de reconvergence à base de liste triée et l’autre sur un mécanisme d’arbitrage entre compteurs de programme. La liste triée permet un passage à l’échelle significativement meilleur à partir de 8 threads par warp.
Keywords : GPU SIMT FPGA
Document type :
Conference papers
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https://hal.inria.fr/hal-01522901
Contributor : Caroline Collange <>
Submitted on : Wednesday, September 23, 2020 - 12:17:41 PM
Last modification on : Friday, September 25, 2020 - 3:10:30 AM

File

CollangeBrunie_ListeChemins_Co...
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Identifiers

  • HAL Id : hal-01522901, version 2

Citation

Caroline Collange, Nicolas Brunie. Parcours par liste de chemins : une nouvelle classe de mécanismes de suivi de flot SIMT. ComPAS 2017 - Conférence d’informatique en Parallélisme, Architecture et Système, Jun 2017, Sophia Antipolis, France. ⟨hal-01522901⟩

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