Synthèse d'architecture sur FPGA sous contrainte de précision des calculs

Nicolas Hervé; Daniel Ménard; Olivier Sentieys

Synthèse d'architecture sur FPGA sous contrainte de précision des calculs

Nicolas Hervé ¹ Daniel Ménard ¹ Olivier Sentieys ¹

1 R2D2 - Reconfigurable and Retargetable Digital Devices

IRISA - Institut de Recherche en Informatique et Systèmes Aléatoires, INRIA Rennes, ENSSAT - École Nationale Supérieure des Sciences Appliquées et de Technologie

Résumé : Les FPGAs sont de plus en plus considérés comme une solution incontournable pour les applications de traitement du signal. Dans le même temps, les contraintes telles que le coût, la consommation et le temps de mise sur le marché des applications de traitement du signal exigent la mise en oeuvre de méthodologies d'implantation automatique d'algorithmes spécifiés en virgule flottante au sein de FPGAs utilisant l'arithmétique virgule fixe. Dans cet article, une nouvelle méthodologie de synthèse d'architecture sous contrainte de précision est présentée. Cette approche s'appuie sur une bibliothèque d'opérateurs arithmétiques virgule fixe caractérisant le coût des opérateurs en fonction de leur largeur. Pour obtenir une implantation efficace, le processus d'optimisation est couplé avec la synthèse d'architecture. De plus, l'évaluation de la précision est réalisée par une approche analytique permettant ainsi d'obtenir des temps d'optimisation raisonnables.

Mots-clés : Outils de CAO Architecture Matérielle Arithmétique virgule fixe FPGA Outils de CAO.

Document type :

Conference papers

Domain :

Computer Science [cs] / Hardware Architecture [cs.AR]

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https://hal.inria.fr/inria-00000853
Contributor : Elodie Foret <>
Submitted on : Friday, November 25, 2005 - 1:47:18 PM
Last modification on : Friday, November 16, 2018 - 1:25:07 AM
Long-term archiving on : Friday, September 14, 2012 - 3:55:48 PM

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